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AT73C240
8.3
SPI Interface Timing
Figure 8-2.
SPI_CSB
SPI Timing
Tssen
Tc
Thsen
Twl
SPI_CLK
Twh
SPI_DIN
SPI_DOUT
Tdsdo
Tssdi
Thsdi
Thsdo
Table 8-1.
SPI Timing Parameters
Parameter
Tc
Twl
Twh
Tssen
Thsen
Tssdi
Thsdi
Tdsdo
Thsdo
Description
SPI_CLK min period
SPI_CLK min pulse width low
SPI_CLK min pulse width high
Setup time SPI_CSB falling to SPI_CLK rising
Hold time SPI_CLK falling to SPI_CSB rising
Setup time SPI_DIN valid to SPI_CLK falling
Hold time SPI_CLK falling to SPI_DIN not valid
Delay time SPI_CLK rising to SPI_DOUT valid
Hold time SPI_CLK rising to SPI_DOUT not valid
Min
150 ns
50 ns
50 ns
50 ns
50 ns
20 ns
20 ns
-
0 ns
Max
-
-
-
-
-
-
-
20 ns
-
13
6464A–PMAAC–28-Apr-09
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